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Verilog 编写Avalon 总线 USB IP 接口

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悬赏园豆:5 [已关闭问题] 关闭于 2012-05-24 17:13

各位高手,我在使用SOPC时需要对USB的控制芯片 ISP1362写一个控制接口的IP核,用这一接口来使ISP1362外接一个摄像头,完成视频采集。这是在DE2-C70中的给出的例程,但是因为ISP1362 有三种工作方式:host,device,On The Go .我想完成摄像头采集数据的接收,即,采集的数据经过ISP1362进入我设计的片上系统,这段代码应该怎么修改,我不太懂,还请各位帮我分析一下:

module ISP1362_IF( // avalon MM slave port, ISP1362, host control
     // avalon MM slave, hc interface to nios
     avs_hc_writedata_iDATA,
     avs_hc_readdata_oDATA,
     avs_hc_address_iADDR,
     avs_hc_read_n_iRD_N,
     avs_hc_write_n_iWR_N,
     avs_hc_chipselect_n_iCS_N,
     avs_hc_reset_n_iRST_N,
     avs_hc_clk_iCLK,
     avs_hc_irq_n_oINT0_N,
     // avalon MM slave, dcc interface to nios
     avs_dc_writedata_iDATA,
     avs_dc_readdata_oDATA,
     avs_dc_address_iADDR,
     avs_dc_read_n_iRD_N,
     avs_dc_write_n_iWR_N,
     avs_dc_chipselect_n_iCS_N,
     avs_dc_reset_n_iRST_N,
     avs_dc_clk_iCLK,
     avs_dc_irq_n_oINT0_N,
     // ISP1362 Side
     avs_hc_export_OTG_DATA,
     avs_hc_export_OTG_ADDR,
     avs_hc_export_OTG_RD_N,
     avs_hc_export_OTG_WR_N,
     avs_hc_export_OTG_CS_N,
     avs_hc_export_OTG_RST_N,
     avs_hc_export_OTG_INT0,
     avs_dc_export_OTG_INT1
     );
// to nios
// slave hc
input [15:0] avs_hc_writedata_iDATA;
input    avs_hc_address_iADDR;
input   avs_hc_read_n_iRD_N;
input   avs_hc_write_n_iWR_N;
input   avs_hc_chipselect_n_iCS_N;
input   avs_hc_reset_n_iRST_N;
input   avs_hc_clk_iCLK;
output [15:0] avs_hc_readdata_oDATA;
output   avs_hc_irq_n_oINT0_N;
// slave dc
input [15:0] avs_dc_writedata_iDATA;
input   avs_dc_address_iADDR;
input   avs_dc_read_n_iRD_N;
input   avs_dc_write_n_iWR_N;
input   avs_dc_chipselect_n_iCS_N;
input   avs_dc_reset_n_iRST_N;
input   avs_dc_clk_iCLK;
output [15:0] avs_dc_readdata_oDATA;
output   avs_dc_irq_n_oINT0_N;

 

// ISP1362 Side
inout [15:0] avs_hc_export_OTG_DATA;
output [1:0] avs_hc_export_OTG_ADDR;
output   avs_hc_export_OTG_RD_N;
output   avs_hc_export_OTG_WR_N;
output   avs_hc_export_OTG_CS_N;
output   avs_hc_export_OTG_RST_N;
input   avs_hc_export_OTG_INT0;
input   avs_dc_export_OTG_INT1;

 

 

assign avs_hc_export_OTG_DATA  = avs_dc_chipselect_n_iCS_N ? (avs_hc_write_n_iWR_N ? 16'hzzzz : avs_hc_writedata_iDATA) :  (avs_dc_write_n_iWR_N ? 16'hzzzz : avs_dc_writedata_iDATA) ;
assign avs_hc_readdata_oDATA  = avs_hc_read_n_iRD_N ? 16'hzzzz : avs_hc_export_OTG_DATA;
assign avs_dc_readdata_oDATA  = avs_dc_read_n_iRD_N ? 16'hzzzz : avs_hc_export_OTG_DATA;
assign avs_hc_export_OTG_ADDR  = avs_dc_chipselect_n_iCS_N? {1'b0,avs_hc_address_iADDR} : {1'b1,avs_dc_address_iADDR};
assign avs_hc_export_OTG_CS_N  = avs_hc_chipselect_n_iCS_N & avs_dc_chipselect_n_iCS_N;
assign avs_hc_export_OTG_WR_N  = avs_dc_chipselect_n_iCS_N? avs_hc_write_n_iWR_N : avs_dc_write_n_iWR_N;
assign avs_hc_export_OTG_RD_N  = avs_dc_chipselect_n_iCS_N? avs_hc_read_n_iRD_N  : avs_dc_read_n_iRD_N;
assign avs_hc_export_OTG_RST_N  = avs_dc_chipselect_n_iCS_N? avs_hc_reset_n_iRST_N: avs_dc_reset_n_iRST_N;
assign avs_hc_irq_n_oINT0_N  = avs_hc_export_OTG_INT0;
assign avs_dc_irq_n_oINT0_N  = avs_dc_export_OTG_INT1;

 


endmodule

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提问于:2012-05-23 09:33
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