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当前位置: 博问标签 /仿真/未解决/ 已解决
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30 ISE写的.vhd用ISim仿真时输入全是‘U’

4位的移位寄存器,编写的代码如下 entity shift is port( a,clk,rst:in std_logic; b:out std_logic ); end shift; archite
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10 有关于pcb信号完整性的问题请教各位大哥

小弟刚来博客园,还有很多不懂的地方,还请多多指点,给个方向,感谢 问题1.关于pcb完整性分析,各位大哥都用什么软件,比较好的有哪些。 问题2.关于pcb线宽的问题,pcb线宽,应该怎样根据板子精度来